Aldec.Active.HDL.v6.3.VERILOG.Libaraies.Addon-ZWT

Section

0day

Group

ZWT

Size

72,97 MB

Files

15

Date

2005-03-12

NFO

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 │■■                        » RELEASE iNFORMATiON «                         ■■│ 
 └─┬──────────────────────────────────────────────────────────────────────────┘ 
 │░│ SOFTWARE NAME : Active-HDL 6.3 VERiLOG LiBRARiES ADDON                    
 │░├────────────────────────────────────┬─────────────────────────────────────■ 
 │░│ PROTECTiON    : NONE               │  CRACKER       : TEAM Z.W.T         
 │░├────────────────────────────────────┼─────────────────────────────────────■ 
 │░│ RELEASE TYPE  : RETAIL             │  SUPPLiER      : TEAM Z.W.T         
 │░├────────────────────────────────────┼─────────────────────────────────────■ 
 │░│ RELEASE DATE  : 2005-03-12         │  PACKER        : TEAM Z.W.T         
 │░├────────────────────────────────────┼─────────────────────────────────────■ 
 │░│ LANGUAGE      : ENGLiSH            │  SiZE          : 15 x 5.00MB
 │░├────────────────────────────────────┼─────────────────────────────────────■ 
 │░│ FORMAT        : ZIP/RAR            │  ZiP NAME      : zahvl6**.zip       
 ┌─┴────────────────────────────────────┴─────────────────────────────────────┐ 
 │■■                          » ADDiTiONAL NOTES «                          ■■│ 
 └─┬──────────────────────────────────────────────────────────────────────────┘ 
 │░│ COMPANY       : Aldec                                                     
 │░├──────────────────────────────────────────────────────────────────────────■ 
 │░│ PLATFORM      : WiNALL                                                    
 │░├──────────────────────────────────────────────────────────────────────────■ 
 │░│ SOFTWARE TYPE : FPGA                                                      
 │░├──────────────────────────────────────────────────────────────────────────■ 
 │░│ URL           : http://www.aldec.com/ActiveHDL                            
 ┌─┴──────────────────────────────────────────────────────────────────────────┐ 
 │■■                           » RELEASE NOTES «                            ■■│ 
 └────────────────────────────────────────────────────────────────────────────┘ 

  Active-HDL offers mixed VHDL, Verilog, SystemC\x99 and EDIF design entry,
  simulation and debugging from a single, integrated environment. Multiple FPGA
  vendors (and their synthesis and place-and-route tools) are supported and can
  be managed with ease from one flow throughout the whole project.


  Unpack and install it.


 ┌────────────────────────────────────────────────────────────────────────────┐ 
 │■■                        » CONTACT iNFORMATiON «                         ■■│ 
 └─┬────────────────────────────────────────────────────────────────────────┬─┘ 
 │░│                                                                        │░│ 
 │░│                                                                        │░│ 
 │░│   Contact Us : zwt[at]hushmail[dot]com                                 │░│ 
 │░│                                                                        │░│ 
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 │■■ TEAM ZERO WAiTiNG TiME 2005                                     x!FEAR ■■│ 
 └────────────────────────────────────────────────────────────────────────────┘ 

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